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1. 采用0.18 μm CMOS工艺的高速模拟自适应判决反馈均衡器
展永政,胡庆生
浙江大学学报(工学版)    2019, 53 (12): 2423-2430.   DOI: 10.3785/j.issn.1008-973X.2019.12.021
摘要   HTML PDF(pc) (1478KB)(571)   

采用0.18 μm CMOS工艺设计实现适用于高速背板通信的2抽头模拟自适应判决反馈均衡器(DFE). 采用半速率结构提高电路工作速度, 降低功耗, 并设计由乘法器和积分器构成的模拟最小均方(LMS)自适应电路. 为了改善自适应算法的效果, 对模拟LMS电路进行优化设计, 使其既满足自适应算法的收敛性和稳定性要求, 又能获得较小的积分误差, 并且积分器能够输出稳定的偏置电压. 包括整个焊盘在内的芯片面积为0.378 mm2. 测试结果表明:电路自适应开启时能够对4 GHz损耗为12 dB的信道进行有效补偿, 且垂直张开度和水平张开度分别达到275.5 mV和72 ps, 均衡效果明显优于自适应关闭状态. 当电源电压为1.8 V、工作速度为8 Gb/s时,电路的功耗为49.9 mW. 所设计的模拟自适应DFE电路更适用于25 G及以上的高速通信链路系统.

2. 采用复合左右手结构的微型基片集成波导滤波器设计
胡善文,胡云清,郑海宇,朱伟光,高懿婷
浙江大学学报(工学版)    2019, 53 (12): 2431-2436.   DOI: 10.3785/j.issn.1008-973X.2019.12.022
摘要   HTML PDF(pc) (845KB)(205)   

为了降低滤波器尺寸以适应sub-6 GHz小型化便携式通信设备的要求,提出一种新型锯齿形的叉指电容复合左右手结构,从而提升传统矩形叉指复合左右手结构的耦合电容。相比于传统结构,该新型结构增大了叉指电容值,降低了谐振频率,减小了滤波器的尺寸,可为sub-6 GHz无线通信系统提供工作频段仅为3.3~3.5 GHz的微型滤波器。为了进一步验证新型滤波器的设计理论和性能,设计、加工一款基于该结构的微型化基片集成波导(SIW)滤波器。测试结果表明:改进型结构滤波器的中心频率为3.35 GHz,工作带宽为200 MHz,插入损耗为2.4 dB,滤波器尺寸仅为10.0 mm×7.4 mm;相较于传统复合左右手结构滤波器(中心频率为6.8 GHz),该滤波器的中心频率降低了50%。新型锯齿形叉指复合左右手结构能有效降低射频滤波器的工作频率,减小滤波器尺寸,适用于工作在6 GHz以下频段的微型滤波器设计。

3. 面向情感语音识别的情感维度PAD预测
孙颖,胡艳香,张雪英,段淑斐
浙江大学学报(工学版)    2019, 53 (10): 2041-2048.   DOI: 10.3785/j.issn.1008-973X.2019.10.022
摘要   HTML PDF(pc) (776KB)(346)   

针对现有的情感特征仅从信号的角度对情感进行分析,不能直观反映情感状态的问题,提出将连续情感维度PAD引入情感识别. 实验样本选用TYUT2.0数据库和柏林语音库中的3种情感(悲伤、愤怒和高兴),提取情感特征(韵律特征、共振峰、MFCC和非线性特征). 为了获取客观、精确的PAD维度,利用灰色关联分析(GRA)选取影响P、A、D的主要特征,通过主成分分析(PCA)提取主要特征的主成分,将主成分作为最小二乘支持向量机(LSSVM)的输入预测P、A、D. 分别对情感特征、PAD维度及它们的融合,采用支持向量机进行情感识别. 实验结果表明,该预测方法在一定程度上提高了对P、A、D的预测精度,预测值可以有效识别情感,对情感特征在情感识别方面有一定的补充作用.

4. 基于三步旋转坐标旋转数字计算机算法的直接数字频率综合器实现
张亚云, 刘家瑞, 王志宇, 莫炯炯, 郁发新
浙江大学学报(工学版)    2019, 53 (10): 2034-2040.   DOI: 10.3785/j.issn.1008-973X.2019.10.021
摘要   HTML PDF(pc) (962KB)(337)   

提出基于三步旋转机制的高精度低时延坐标旋转数字计算机 (CORDIC)算法. 该算法通过对输入角度进行二极化重编码来免除剩余旋转角度的运算,利用三步旋转机制对迭代次数进行压缩,结合合并迭代技术进一步减少迭代次数,降低输出时延. 以16位输出位宽为例,对三步旋转CORDIC算法和流水线迭代式算法进行实现,仿真结果表明:三步旋转CORDIC算法与流水线迭代式算法相比,改善了输出精度,输入到输出的时延降低了75%,硬件开销下降了29.2%. 基于三步旋转CORDIC算法,实现了相位累加器位宽为24的直接数字频率综合器 (DDFS);使用加法树结构对多输入加法器进行优化,以提高电路工作频率. 仿真结果表明,该算法的最大幅度误差为8.24 × 10?6,输出时延为38.5 ns.

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